標題: RVC ADV7182基本是原理 [打印本頁]
作者: 球球大魔王    時間: 2018-1-10 13:37
標題: RVC ADV7182基本是原理
攝像機連接到ADV7182并播放CVBS信號

     PAL（576i）信號YUV422 720x576 @ 25fps交錯

ADV7182將CVBS信號轉(zhuǎn)換為數(shù)字圖像，并提供PIXCLK，HSYNC，VSYNC和FIELDS（奇/偶）
ADV7182連接到VIP（視頻輸入端口）
SGA提取VIP奇/偶幀

     SGA將YUV422轉(zhuǎn)換為RGB565
     SGA縮放相框以輸出分辨率（全屏或畫中畫）
     SGA在RGB565中管理疊加源（分辨率等于輸出：不縮放）

Cortex M3由SGA Frame通知并通過LTDC在屏幕上呈現(xiàn)

1.1.3 ADV7182視頻轉(zhuǎn)換器↑

     ADV7182將CVBS信號轉(zhuǎn)換為數(shù)字信號，并提供像素時鐘，水平/垂直同步。

     I2C線路配置
         GPIO引腳115 - > I2C2 SCL
         GPIO引腳114 - > I2C2 SDA
         備用A中的GPIO

1.1.4 VIP

     VIP和ADV7182通過GPIO連接
         GPIO 52 - > VIP_PIXCLK
         GPIO 53 - > VIP_HSYNCH
         GPIO 54 - > VIP VSYNCH
         GPIO [55-62] - > VIP_DAT [7-0]
         GPIO配置在備用A中

1.2軟件配置
1.2.1 ADV7182↑

在里面：
  電源管理= 0x00（系統(tǒng)功能正常運行）
  輸入控制= 0x02（視頻格式：CVBS，Ain3上的模擬輸入CVBS輸入）
  輸出控制= 0x0C（輸出驅(qū)動器啟用，VBI_啟用：所有行過濾和縮放）
  擴展輸出控制= 0x17（富勒范圍，SFL引腳上的輸出SFL信息，VBI期間的空白Cr和Cb值，HS，VS，F(xiàn)IELD三態(tài)，兼容ITU-R BT.656-3）
  狀態(tài)3 = 00
  成形濾波器控制1 = 0x41（Autonarrow陷波對于質(zhì)量較差的信號源或具有梳齒的寬帶濾波器以獲得高質(zhì)量輸入（：p），SH1 C濾波器re：p）
  ADI控制2 = 0x40（LLC引腳有效）
  0x52 = 0xCB

1.2.2 VIP↑
VIP配置為輸出ITU-R BT.656協(xié)議，數(shù)據(jù)中啟用嵌入式同步代碼。
VIP控制寄存器
   比特31:24 A [7：0]：阿爾法。該字段包含用于在運行時填充MSB的Alpha值
     RGB到ARGB模式。每個RGB像素存儲為32位字，使用A作為填充字節(jié)。
     （00000000）= 0x00
   位23 INTL_en：隔行啟用。
     設(shè)置時，奇數(shù)/偶數(shù)場檢測被激活。這個位必須一起設(shè)置
     與雙DMA模式位（VIP_MASK [12] = DMADual = 0b1）。嵌入代碼必須
     正確編程（VIP_EFECR和VIP_OFECR寄存器）。
     清除時只檢測到偶數(shù)場。
     （1）
   位22 SGA_tfr_en：當(dāng)SGA被編程時，該位使能直接傳輸?shù)絊GA
     在DMA模式下工作。在這種情況下，突發(fā)大小自動設(shè)置為8。
     （0）
   位21:19 DMA_BURST_SIZE：該字段用于指定DMA突發(fā)大小。一定是
     與DMA一致編程。突發(fā)大小應(yīng)該小于行的長度。
     （101）==>突發(fā)大小64
   位18 WAIT_STATE_en：該位在讀取本地存儲器時會導(dǎo)致一個等待狀態(tài)
     （0）
   位17 CROP_sel：裁剪選擇
     0：始終產(chǎn)生FIFO緩沖寫入使能
        無論CROP_sel如何，F(xiàn)IFO緩沖區(qū)寫指針都只按照遞增
        VIP_CSTART和VIP_CSTOP寄存器
   位16 EAV_sel：活動視頻選擇結(jié)束
     0：只有EAV符號表示有效視頻結(jié)束
   位15:13保留以供將來使用
     （000）
   位12 EMBT：嵌入式同步類型
     ITU-R BT.656協(xié)議
   位11：8 TRANS [3：0]：轉(zhuǎn)換類型
     YUV 422（CbYCrY）
   Bit 7 VS_pol：通知垂直同步信號的有效狀態(tài)
     VS_pol = 0：垂直同步信號低電平有效。像素在HSYNC時被捕獲
                 無效和VSYNC = 1。
   Bit 6 HS_pol：通知水平同步信號的有效狀態(tài)
     HS_pol = 0：水平同步信號低電平有效。像素在HSYNC = 1時被捕獲。
   位5 PCK_pol：通知像素時鐘的有效邊沿
     PCK_pol = 1：數(shù)據(jù)鎖存在像素時鐘的上升沿
   位4 EMB：嵌入式同步啟用
     EMB = 1：嵌入代碼用于獲取數(shù)據(jù)
VIP作物起始點寄存器（VIP_CSTART）
    起始點寄存器= 0
  VIP作物停止點寄存器（VIP_CSTOP）
    停止點寄存器= 0xFFFF（無限制）720x2（720像素/行）




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