標(biāo)題: 一種verilog實(shí)現(xiàn)uart串口通信硬件方案源碼 [打印本頁]
作者: XXT    時(shí)間: 2018-6-27 13:22
標(biāo)題: 一種verilog實(shí)現(xiàn)uart串口通信硬件方案源碼
在FPGA上實(shí)現(xiàn)串口收發(fā)。這里給出硬件代碼，直接燒入FPGA，調(diào)整波特率為38400即可電腦與其通信。FPGA使用晶振為50Mhz。上傳的附件為包含了全部文件的ise工程，直接打開可用，其中uart.v為verilog代碼，.ucf是引腳約束。


全部資料51hei下載地址：
uart_banji.zip (523.96 KB, 下載次數(shù): 52)


作者: XXT    時(shí)間: 2018-6-27 13:23
如果將此段代碼燒入兩塊FPGA板子可以互相通信，我用的是basys2板子。
作者: haha2613    時(shí)間: 2018-7-3 07:29
下載看看先
作者: wikun    時(shí)間: 2019-7-25 00:32
這個(gè)應(yīng)該是用xlink寫的
作者: fpga小白學(xué)習(xí)ing    時(shí)間: 2019-10-6 16:51
剛好最近在學(xué)習(xí)fpga這塊的東西，十分感謝樓主。



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