標(biāo)題: VHDL DDS正弦信號(hào)發(fā)生器設(shè)計(jì) [打印本頁]
作者: jagger007    時(shí)間: 2020-1-1 14:35
標(biāo)題: VHDL DDS正弦信號(hào)發(fā)生器設(shè)計(jì)
一、設(shè)計(jì)原理和方法
正弦信號(hào)發(fā)生器的結(jié)構(gòu)由 3 部分組成，如圖 2-1 所示。6 位計(jì)數(shù)器或地址發(fā)生器、數(shù)據(jù)
ROM 和 D/A0832。性能良好的正弦信號(hào)發(fā)生器的設(shè)計(jì)要求此 3 部分具有高速性能，且數(shù)
據(jù) ROM 在高速條件下，占用最少的邏輯資源，設(shè)計(jì)流程最便捷，波形數(shù)據(jù)獲得最方便。頂
層文件 SINGT.VHD 在 FPGA 中實(shí)現(xiàn)，包含 2 個(gè)部分：ROM 的地址信號(hào)發(fā)生器和存儲(chǔ)正弦
數(shù)據(jù)的 ROM。ROM 由 LPM_ROM 模塊構(gòu)成，設(shè)計(jì)簡(jiǎn)便并且可以達(dá)到最優(yōu)。地址發(fā)生器的
時(shí)鐘 CLK 的輸入頻率 f。與每周期的波形數(shù)據(jù)點(diǎn)數(shù)（在此選擇 64 點(diǎn)），以及 D/A 輸出的頻
率 f 的關(guān)系是：f=fo/64。
二、設(shè)計(jì)任務(wù)及要求
1.設(shè)計(jì)任務(wù):
利用實(shí)驗(yàn)箱上的 D/A 轉(zhuǎn)換器和示波器設(shè)計(jì)正弦波發(fā)生器，可以在
示波器上觀察到正弦波。
2.設(shè)計(jì)要求:
（1）設(shè)計(jì)一個(gè)輸出頻率為 1KHZ 的正弦波。
（2）連接實(shí)驗(yàn)箱上的 D/A 轉(zhuǎn)換器和示波器，觀察正弦波波形。
2三、設(shè)計(jì)方案
（1）設(shè)計(jì)能存儲(chǔ)數(shù)據(jù)的 ROM 模塊，將正弦波的正弦信號(hào)數(shù)據(jù)存儲(chǔ)在在 ROM 中，通過地
址發(fā)生器讀取，將正弦波信號(hào)輸入八位 D/A 轉(zhuǎn)化器，在示波器上觀察波形。
（2）用 VHDL 編寫正弦波信號(hào)數(shù)據(jù)，將正弦波信號(hào)輸入八位 D/A 轉(zhuǎn)化器，在示波器上觀
察波形。
圖 1 設(shè)計(jì)框圖
四、實(shí)現(xiàn)步驟
1.定制 ROM
ROM 的 數(shù) 據(jù) 位 選 擇 為 8 位 ， 數(shù) 據(jù) 數(shù) 選 擇 128 個(gè) 。 利 用
megawizard plug-in manager 定制正弦信號(hào)數(shù)據(jù) ROM 宏功能塊，并將上面的波形
數(shù)據(jù)加載于此 ROM 中。如圖 2 所示。
圖 2 ROM 存儲(chǔ)的數(shù)據(jù)
32.設(shè)計(jì)頂層
頂層設(shè)計(jì)主要是通過編寫 VHDL 語言或設(shè)計(jì)原理圖用于產(chǎn)生計(jì)數(shù)信號(hào)和調(diào)用
ROM 存儲(chǔ)的數(shù)據(jù)并輸出。

EDA設(shè)計(jì).pdf

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DDS 正弦信號(hào)發(fā)生器設(shè)計(jì)



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