標(biāo)題: 請(qǐng)問這種MCU作為從機(jī)的時(shí)序怎么理解怎么寫程序 [打印本頁]
作者: 壓著我頭發(fā)啦    時(shí)間: 2021-11-2 14:27
標(biāo)題: 請(qǐng)問這種MCU作為從機(jī)的時(shí)序怎么理解怎么寫程序
MCU作為從機(jī)，檢測(cè)ADC的數(shù)據(jù)輸出。DCLK頻率8.192mhz。使用的是xilinx zynq030.

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作者: 188610329    時(shí)間: 2021-11-2 18:17
從機(jī)的MCU  DCLK 最好可以邊沿檢測(cè)，這樣程序會(huì)簡(jiǎn)單很多。

收到 DCLK 下降沿后 判斷 DRDY 電平是否為高，是的話，準(zhǔn)備開始接收數(shù)據(jù)。
每收到一個(gè)下降沿，就讀取Dout一位數(shù)據(jù)。同時(shí)判斷一下 DRDY 的電平，如果是高電平，表示這是最后一位數(shù)據(jù)。
作者: Hephaestus    時(shí)間: 2021-11-2 19:34
不知道你怎么配置的，8MHz對(duì)于單片機(jī)來說太快了（除非自帶符號(hào)這種波形的SPI接口），既然你用了FPGA，變成16位或32位并行數(shù)據(jù)，讓單片機(jī)中斷接收更舒服一些。
作者: 壓著我頭發(fā)啦    時(shí)間: 2021-11-2 20:36
Hephaestus 發(fā)表于 2021-11-2 19:34
不知道你怎么配置的，8MHz對(duì)于單片機(jī)來說太快了（除非自帶符號(hào)這種波形的SPI接口），既然你用了FPGA，變成1 ...

一共采集了20多路，沒法轉(zhuǎn)并了



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