標題: 基于cd4046鎖相倍頻電路的設計 我沒有思路,麻煩各位指點指點 [打印本頁]
作者: dxl66    時間: 2023-12-13 12:35
標題: 基于cd4046鎖相倍頻電路的設計 我沒有思路,麻煩各位指點指點
輸入信號頻率為1khz正弦波，輸出信號為方波且頻率為輸入信號的1-5倍。我沒有思路，麻煩各位指點指點。
作者: Hephaestus    時間: 2023-12-13 15:15
VCO輸出接分頻器（分頻倍數(shù)1~5）接PhaseDetector即可。
作者: 老愚童63    時間: 2023-12-13 15:26
本帖最后由 老愚童63 于 2023-12-14 15:10 編輯

3,4腳之間插入一片CD4017或者4518之類的分頻電路。這個電路可以參考一下

4046倍頻電路.png (45.08 KB, 下載次數(shù): 95)

4046倍頻電路.png
作者: dxl66    時間: 2023-12-13 16:28
老愚童63 發(fā)表于 2023-12-13 15:26
3,4腳之間插入一片CD4017或者4518之類的分頻電路

好，謝謝
作者: dxl66    時間: 2023-12-13 16:29
Hephaestus 發(fā)表于 2023-12-13 15:15
VCO輸出接分頻器（分頻倍數(shù)1~5）接PhaseDetector即可。

行，我去研究研究，謝謝
作者: zhuls    時間: 2023-12-14 14:38
不明白，“輸入信號頻率為1khz正弦波，輸出信號為方波且頻率為輸入信號的1-5倍”
這個用分頻能做到？有實際的電路嗎？
不應該用倍頻電路嗎？
作者: Hephaestus    時間: 2023-12-14 14:55
zhuls 發(fā)表于 2023-12-14 14:38
不明白，“輸入信號頻率為1khz正弦波，輸出信號為方波且頻率為輸入信號的1-5倍”
這個用分頻能做到？有實 ...

PLL是嘎哈的？STM32 HSI頻率8MHz那么主頻72MHz又是怎么來的？
作者: zhuls    時間: 2023-12-14 15:37
Hephaestus 發(fā)表于 2023-12-14 14:55
PLL是嘎哈的？STM32 HSI頻率8MHz那么主頻72MHz又是怎么來的？

是的，我下了4046的手冊，這是一顆神奇的IC~
作者: coody_sz    時間: 2023-12-14 17:25
經典用法即可，VCO輸出接分頻器分頻輸出與參考信號一起接鑒相器，鑒相器輸出控制VCO。



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