標(biāo)題: allegro導(dǎo)入網(wǎng)表遇到flash問題 [打印本頁]
作者: ther1    時(shí)間: 2024-5-30 11:08
標(biāo)題: allegro導(dǎo)入網(wǎng)表遇到flash問題
起初是在import  原理圖產(chǎn)生的網(wǎng)表  到PCB的brd文件時(shí)所遇到如圖所示的問題，但是我檢查過路徑以及pad和dra和psm文件都是存在的。
然后曾經(jīng)我遇到這個(gè)問題是關(guān)閉anti_pad然后保存就可以解決問題了，但是這次發(fā)現(xiàn)pad文件本身就有問題：

DEFAULT INTERNAL是我關(guān)閉anti_pad產(chǎn)生的問題（貌似關(guān)閉FLASH可解決），下面的NCDRILL是我不做任何改動(dòng)僅打開pad文件然后保存就會(huì)出現(xiàn)的問題，在網(wǎng)上沒有找到實(shí)際解決辦法，故來此想請(qǐng)問一下各位大佬們此問題產(chǎn)生的原因以及解決辦法。
作者: ther1    時(shí)間: 2024-5-30 15:22
目前解決了，就是說要對(duì)單個(gè)器件的封裝create symbol，然后再export libraries然后導(dǎo)入網(wǎng)表就沒問題了
作者: ther1    時(shí)間: 2024-5-30 15:23
目前已經(jīng)解決，就是說要把那個(gè)器件create symbols→export libraries最后再導(dǎo)入原理圖網(wǎng)表就沒問題了



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