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為什么AD畫PCB的時(shí)候,把線調(diào)粗會(huì)報(bào)錯(cuò)?

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發(fā)布時(shí)間: 2018-2-20 05:19

正文摘要:

新手用Altium Designer,遇到問題想請教一下各位。 布線的時(shí)候,默認(rèn)10mil的時(shí)候就不會(huì)報(bào)錯(cuò)。但是這個(gè)是power回路,電流要求高所以要71mil,我把線調(diào)整為71mil的時(shí)候就開始報(bào)錯(cuò)了。 請問有人知道怎么回事 ...

回復(fù)

ID:274747 發(fā)表于 2018-2-27 21:25
默認(rèn)的間距要求,不適合你那71的,手動(dòng)調(diào)節(jié)一下應(yīng)該就可以了
ID:285244 發(fā)表于 2018-2-24 17:33
報(bào)的什么錯(cuò)?線寬的錯(cuò)誤還是clearance的錯(cuò)誤,改規(guī)則就好了。
ID:285220 發(fā)表于 2018-2-24 16:41
可能是造成短路了
ID:285193 發(fā)表于 2018-2-24 15:08
改規(guī)則。默認(rèn)規(guī)則線寬都是10mil
ID:211273 發(fā)表于 2018-2-23 19:16
兩條線間隔太近。
ID:285025 發(fā)表于 2018-2-23 18:01
有線寬等規(guī)則設(shè)置限制了
ID:285017 發(fā)表于 2018-2-23 17:21
因?yàn)槟氵`反了規(guī)則。具體要到altium的布線規(guī)則中去看
ID:279601 發(fā)表于 2018-2-23 13:45
你需要在布線規(guī)則里設(shè)置一下線寬,默認(rèn)最大線寬是10mile,超出時(shí)會(huì)報(bào)錯(cuò),你可以根據(jù)你的需要去設(shè)置最大線寬,最小線寬,設(shè)置完后,只要你畫的線不超過最大線寬就不會(huì)出錯(cuò)了
ID:185372 發(fā)表于 2018-2-23 11:40
這個(gè)跟線距有關(guān)系,電流可以考慮把銅層加厚,我們普通大概1盎司左右,這里可以加大銅層厚度。
ID:266943 發(fā)表于 2018-2-23 08:56
design rules routing width 更改線寬,調(diào)大點(diǎn)就好了
ID:148552 發(fā)表于 2018-2-23 08:42
PCB模式下打開規(guī)則(快捷鍵DR),將線寬的最大值調(diào)大,實(shí)際畫PCB時(shí),如果與規(guī)則沖突,就會(huì)報(bào)錯(cuò),自己可以根據(jù)實(shí)際情況修改規(guī)則。

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UC截圖20180223083824.png

UC截圖20180223083905.png (28.62 KB, 下載次數(shù): 95)

UC截圖20180223083905.png
ID:266943 發(fā)表于 2018-2-23 08:39
design--->rule—>routing,width更改線寬就行了
ID:284869 發(fā)表于 2018-2-23 02:50
兩條線的距離也算短路的,弄細(xì)點(diǎn)就行了
ID:284858 發(fā)表于 2018-2-22 23:18
線的最小間距設(shè)置下就可以了
ID:284846 發(fā)表于 2018-2-22 21:33
跟著學(xué)習(xí)了!
ID:284293 發(fā)表于 2018-2-22 19:42
距離變小了,可以在規(guī)則里面改一下距離,或者直接把距離限制取消掉
ID:283945 發(fā)表于 2018-2-22 19:12
檢查規(guī)則是否符合要求
ID:284773 發(fā)表于 2018-2-22 15:19
1、工具欄Design->Rules, 檢查Electrical下的Clearance是否過小
2、工具欄Tools->Reset Error Markers, 用Tools->Design Rule Check去查看是否報(bào)錯(cuò)
ID:284756 發(fā)表于 2018-2-22 14:04
規(guī)則問題
ID:163228 發(fā)表于 2018-2-22 11:33
因?yàn)槟愕囊?guī)則中設(shè)置的線間距設(shè)置大于調(diào)粗后的實(shí)際線間距所以報(bào)錯(cuò)。
ID:284715 發(fā)表于 2018-2-22 10:54
改變一下design rules應(yīng)該就可以了吧
ID:147076 發(fā)表于 2018-2-22 10:40
設(shè)計(jì)規(guī)則里改一下線的間距要求。然后reset errormark。另外,你這兩條線部分區(qū)域可以拉大一點(diǎn)間隔,沒有必要一直挨那么近。
ID:284703 發(fā)表于 2018-2-22 09:56
布線規(guī)則設(shè)置一下,將線間距設(shè)置小一點(diǎn)就可以消除報(bào)錯(cuò)。
ID:284699 發(fā)表于 2018-2-22 09:11
修改一下規(guī)則,線徑規(guī)則和線與線之間的規(guī)則
ID:272269 發(fā)表于 2018-2-21 18:45
線的最小間距設(shè)置和線寬設(shè)置看一下
大概就是這個(gè)問題
ID:188748 發(fā)表于 2018-2-20 15:21
這是ad??
ID:89515 發(fā)表于 2018-2-20 14:03
元件布局完成后,先要設(shè)置布線規(guī)則。默認(rèn)規(guī)則怎么行呢。!
ID:222948 發(fā)表于 2018-2-20 14:02
兩條線與線之間的間距也有要求的,可以用向?qū)г囈幌?/td>

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