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維特比編碼譯碼器 Viterbi譯碼算法 verilog代碼

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發(fā)布時(shí)間: 2022-3-28 20:27

正文摘要:

本壓縮包中包含維特比編碼和譯碼的全部verilog代碼,包含測(cè)試代碼和部分仿真結(jié)果Viterbi 算法是一種最大似然譯碼算法,它是通過(guò)計(jì)算累積漢明距離,在卷積網(wǎng)絡(luò)圖上尋找一條與接收碼字具有最小漢明距離的最大似然路徑 ...

回復(fù)

ID:1079826 發(fā)表于 2023-5-25 14:47
為什么沒(méi)有bmg模塊和parameter.v
ID:1034281 發(fā)表于 2022-6-13 11:09
為什么我仿真的VD的時(shí)候,后面輸出是高阻態(tài)??

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