allegro導(dǎo)入網(wǎng)表遇到flash問題

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發(fā)布時(shí)間: 2024-5-30 11:08

起初是在import 原理圖產(chǎn)生的網(wǎng)表到PCB的brd文件時(shí)所遇到如圖所示的問題，但是我檢查過路徑以及pad和dra和psm文件都是存在的。 DEFAULT INTERNAL是我關(guān)閉anti_pad產(chǎn)生的問題（貌似關(guān) ...

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ID:945345 發(fā)表于 2024-5-30 15:23

目前已經(jīng)解決，就是說要把那個(gè)器件create symbols→export libraries最后再導(dǎo)入原理圖網(wǎng)表就沒問題了

ID:945345 發(fā)表于 2024-5-30 15:22

目前解決了，就是說要對單個(gè)器件的封裝create symbol，然后再export libraries然后導(dǎo)入網(wǎng)表就沒問題了

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