關(guān)于PCB制版排提前查錯(cuò)誤的問題

ID:402379 · 發(fā)表于 2018-9-25 20:39

如何在原理圖階段就能排查出繪制PCB時(shí)出現(xiàn)的問題？
或者說如何避免打樣后不能用的資源浪費(fèi)？

ID:277374 · 發(fā)表于 2018-9-25 21:22

原理圖階段，在左邊工程欄中右鍵，第一項(xiàng)就是檢查，沒有錯(cuò)誤的話，不出現(xiàn)對(duì)話框（對(duì)話框在systerm中可以調(diào)出來）。這個(gè)檢查沒有太多用途，錯(cuò)誤還是需要人工檢查出來的。比如你想用P1.0做AD采集口，不小心畫成了P2.1，DXP是無論如何也查不出來的。

ID:389097 · 發(fā)表于 2018-9-26 03:37

原理圖方面軟件只能檢測(cè)你連接性的問題，電路原理是否有問題那只能自己檢查。原理圖轉(zhuǎn)到pcb文件時(shí)出現(xiàn)的錯(cuò)誤或者警告，一定要注意和解決。pcb方面，則要對(duì)線路的安全間距和連接性進(jìn)行檢查，這個(gè)軟件可以做得到。這樣都是打樣pcb必須進(jìn)行的事情。另外，避免出現(xiàn)打樣不能用的話，那些原件封裝一定要畫準(zhǔn)確。其他線路的花還可以割斷用用線連接，封裝的不對(duì)的話，像那些管腳密的ic想用線連都連不上，那估計(jì)這打樣的pcb直接報(bào)廢。

ID:402486 · 發(fā)表于 2018-9-26 08:32

原理圖階段，在左邊工程欄中右鍵，第一項(xiàng)就是檢查，沒有錯(cuò)誤的話，不出現(xiàn)對(duì)話框（對(duì)話框在systerm中可以調(diào)出來）。這個(gè)檢查沒有太多用途，錯(cuò)誤還是需要人工檢查出來的。比如你想用P1.0做AD采集口，不小心畫成了P2.1，DXP是無論如何也查不出來的。

ID:319344 · 發(fā)表于 2018-9-26 09:28

補(bǔ)充一下，我覺得還需要仔細(xì)核對(duì)芯片引腳連接，尤其是三腳的功能對(duì)應(yīng)，如穩(wěn)壓芯片，三極管，最好自己查一下具體你用到的型號(hào)的，想當(dāng)然就容易出問題。如果還需要后期出了問題方便檢查的話，且用的是貼片元件，就在你認(rèn)為必要的位置設(shè)置測(cè)試點(diǎn)(原理圖上是一個(gè)符號(hào)，PCB上是一個(gè)過孔)，算是一種檢查的補(bǔ)救措施吧

ID:396914 · 發(fā)表于 2018-9-26 10:39

原理圖階段只是對(duì)自己需求功能的設(shè)計(jì)，不想要的功能可以刪掉。原理圖導(dǎo)入到PCB的網(wǎng)絡(luò)及元件名稱一定要對(duì)應(yīng)好

ID:403145 · 發(fā)表于 2018-9-27 13:59

新器件封裝要仔細(xì)核對(duì)！還有做DRC和單網(wǎng)絡(luò)報(bào)告。

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