AD17出現(xiàn)的一個(gè)問題（BUG）

ID:487133 · 發(fā)表于 2019-5-4 16:46

今天在畫原理圖時(shí)遇到的一個(gè)問題，當(dāng)放入了-5V網(wǎng)絡(luò)之后我的地網(wǎng)被自動(dòng)并入了-5的網(wǎng)，兩者本身無電氣連接的關(guān)系，在生成PCB時(shí)它將我的地網(wǎng)全變成了-5V，導(dǎo)致我原來已經(jīng)畫好的地全成了-5V的網(wǎng)絡(luò)，解決方法是把UDDATA PCB中GND TO -5V這一項(xiàng)去掉，但我對這個(gè)現(xiàn)象仍感覺很奇怪，是AD17之前存在的BUG嗎？

ID:487133 · 發(fā)表于 2019-5-5 20:15

主貼的那個(gè)方法仍然會(huì)導(dǎo)致各種奇葩問題，后面真正解決的方法是把上圖這個(gè)-5V先不添加更新PCB，然后在添加這個(gè)-5V更新就好了。鼓搗了半天雖然解決了但還是不明白產(chǎn)生的原因，原理圖都沒變都后來就能正常更新PCB了，感覺就是BUG吧。

ID:382890 · 發(fā)表于 2019-5-13 17:15

原理圖上-5V和地短了

ID:140489 · 發(fā)表于 2019-5-23 11:31

-5V 和地畫斷路了，哪里是什么bug，

ID:276663 · 發(fā)表于 2019-5-23 12:23

明明是你自己畫短路了，電容中間一根直線你看不到嗎？

ID:487133 · 發(fā)表于 2019-6-3 21:43

突然看到這個(gè)帖子，重新看了一遍電路的確是自己的失誤造成了該錯(cuò)誤并不是BUG,如果管理員看到的話也麻煩刪一下帖子。

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