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1.畫出實驗電路
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2019-12-16 12:00 上傳
設(shè)計的電路圖如下:
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2019-12-16 10:55 上傳
按照圖 1 所示,在仿真軟件 Multisim 中完成原理圖繪制,觀察顯示結(jié)果,再將時鐘信號源頻率設(shè)置為 10Hz,觀察顯示結(jié)果,并對前后兩種顯示結(jié)果進(jìn)行簡單地比較與分析。 圖一在上面,在改變了頻率了之后,發(fā)現(xiàn)了如果頻率越大,那么上面的顯示器改變的越快,原本 100 赫茲改為了 10 赫茲了以后,發(fā)現(xiàn)變慢了一倍。
2.觀察仿真結(jié)果
可以看出,上面的時鐘可以從 0-57,符合 2 位 58 進(jìn)制計數(shù)器的電路,仿真結(jié)果是正確的。
3.驗證RCO輸出端與計數(shù)值QD-QA的邏輯關(guān)系
第一個芯片RCO連接第二個的 CLK,當(dāng)?shù)谝粋芯片的QD-QA顯示為 1111 時,此時的第一個芯片的 RCO 變成了 1,那么此時第二個的 CLK 就變成 1,于是第二個芯片開始工作,此時第二個芯片的 QD-QA 為 0001,第一個芯片則變成 0000。以此循環(huán),每當(dāng)?shù)谝粋芯片的 QD-QA 顯示為 1111 時,第二個芯片都會+1,直到 QD-QA 變成0011 為止。此時當(dāng)?shù)谝粋 QD-QA 顯示 1011。結(jié)束,從新開始,這就是一個輪回。
4.ENP和ENT的作用
ENP 和 ENT 兩個的作用是當(dāng)計數(shù)到 57 的時候,可以做到清零變成 00000000 最初始的位置。
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