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CCS10環(huán)境下的工程文件,使用4Mhz的XT2晶振分頻后,作為FLL參考頻率
單片機(jī)源程序如下:
- //#include <msp430.h>
- #include "msp430F5529.h"
- /*
- * Jeason 2019.05.09 于 青島大學(xué)
- */
- void clock_init(unsigned char Fre);
- // 主頻初始化函數(shù) 可以設(shè)置指定的頻率
- // 理論參數(shù)是 1~ 40+ 的整數(shù) 建議不要超過45 (具體性能還要考慮自身芯片體質(zhì)�。。。�
- //實(shí)際使用中建議參數(shù)大于5 當(dāng)參數(shù)小于5以后會(huì)導(dǎo)致頻率卡在3.5MHz,原因未知
- void main(void)
- {
- int i;
- WDTCTL = WDTPW | WDTHOLD; // stop watchdog timer
- clock_init(45);
- P2DIR |= BIT2; // 配置P2.2為輸出模式
- P2SEL |= BIT2; // 功能復(fù)用:SMCLK輸出 (子系統(tǒng)主時(shí)鐘)
- P7DIR |= BIT7; // 配置P7.7為輸出模式
- P7SEL |= BIT7; // 功能復(fù)用:MCLK輸出 (主系統(tǒng)時(shí)鐘)
- P1DIR |= BIT0; // 配置P1.0為輸出模式
- while(1)
- {
- }
- }
- void clock_init(unsigned char Fre)
- {
- P5SEL |= BIT2|BIT3|BIT4|BIT5;//開啟外部兩個(gè)時(shí)鐘
- UCSCTL6 |= XCAP_3|XT1OFF; // XT1 相關(guān) 配置
- UCSCTL6 |= XT2DRIVE_0 |XT2OFF; // XT2 相關(guān) 配置
- //以下是提升核心電壓部分的代碼
- PMMCTL0_H = 0xA5; //開PMM電源管理
- SVSMLCTL |= SVSMLRRL_1 + SVMLE; //配置SVML電壓
- PMMCTL0 = PMMPW + PMMCOREV_3; //配置內(nèi)核電壓
- while((PMMIFG & SVSMLDLYIFG ) == 0); //等待設(shè)置完成
- PMMIFG &= ~(SVMLVLRIFG + SVMLIFG + SVSMLDLYIFG);
- if((PMMIFG & SVMLIFG) == 1) //判斷內(nèi)核電壓是否上升到VSVML
- while((PMMIFG & SVMLVLRIFG) == 0); //如果沒有等待
- SVSMLCTL &= ~SVMLE; //關(guān)掉SVML模塊
- PMMCTL0_H = 0X00;
- __bis_SR_register(SCG0); //該語法為固定格式,意為將括號(hào)內(nèi)的變量置位,SCG0與系統(tǒng)工作模式有關(guān),此時(shí) MCLK 暫停工作
- UCSCTL0 = 0; //先清零,F(xiàn)LL 運(yùn)行時(shí),該寄存器系統(tǒng)會(huì)自動(dòng)配置,不用管
- UCSCTL6 = (UCSCTL6&(~(XT2OFF|XT1OFF))|XCAP_3|XT2DRIVE_0);
- UCSCTL3 = (5<<4)|(2<<0); // 選擇 XTAL2 的時(shí)鐘信號(hào)作為參考信號(hào) 并且分頻到1MHz
- if(Fre < 5)
- UCSCTL1 = DCORSEL_2;
- else if(Fre<15)
- UCSCTL1 = DCORSEL_4;
- else
- UCSCTL1 = DCORSEL_7;
- UCSCTL2 = (Fre-1);
- __bic_SR_register(SCG0);
- __delay_cycles(782000);
- while (SFRIFG1 & OFIFG) { // Check OFIFG fault flag
- UCSCTL7 &= ~(XT2OFFG + XT1LFOFFG + DCOFFG); // Clear OSC flaut Flags
- SFRIFG1 &= ~OFIFG; // Clear OFIFG fault flag
- }
- UCSCTL4 = UCSCTL4&(~(SELS_7|SELM_7))|SELS_3|SELM_3;
- }
復(fù)制代碼
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