Altium designer 生成PCB時(shí)報(bào)出未將對(duì)象引用設(shè)置到對(duì)象的實(shí)例

ID:1017844 · 發(fā)表于 2022-4-12 16:31

各位大佬，誰(shuí)知道AD畫(huà)完原理圖(元件封裝都添加好了的)時(shí)生成PCB時(shí)報(bào)出這種錯(cuò)誤是怎么回事，哪兒沒(méi)弄對(duì)

ID:96682 · 發(fā)表于 2022-4-12 22:31

樓主是從哪里生成 PCB 的？

ID:1017844 · 發(fā)表于 2022-4-13 08:22

wc86110 發(fā)表于 2022-4-12 22:31
樓主是從哪里生成 PCB 的？

從PCB里和原理圖里都生成過(guò)，一樣的結(jié)果

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