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小弟運(yùn)放和模擬電路學(xué)的很差，很多東西不太理解，下圖是我用multisim仿真的用一個AD8032搭出來的同相加法電路，該電路基本就是以前課本里面學(xué)過的，應(yīng)該沒有什么問題，R2=R6=R5, R7=2R1,此情況下，輸出應(yīng)該是兩個同相輸入之和，但是仿真時卻發(fā)現(xiàn)，兩個同相輸入端輸入毫伏電壓值時比如1mv，輸出結(jié)果是不對的，并不是兩個同相輸入端之和，甚至還出現(xiàn)了負(fù)值，而兩個同相輸入端輸入值大于毫伏值，比如為1V時，輸出結(jié)果是正確的，為1.9V，接近2V。
為什么會有這種差異呢？是我仿真設(shè)置不對，還是另有原因？希望高手能分析下，謝謝！
同相端輸入1mv，輸出結(jié)果為負(fù)值，并非兩者之和，如下，
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2022-9-30 01:54 上傳
同相端輸入1V，輸出結(jié)果正確，如下
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2022-9-30 01:55 上傳
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