用FPGA怎么設(shè)計(jì)一個(gè)可逆計(jì)數(shù)器？十二進(jìn)制的

ID:1056094 · 發(fā)表于 2022-12-7 11:22

我不理解他的這個(gè)可逆計(jì)數(shù)器仿真的波形應(yīng)該是怎么樣的？0-11然后11-0嗎？

ID:123289 · 發(fā)表于 2022-12-8 10:16

到少有以下引腳：
1、時(shí)鐘：CLK
2、增減選擇：=0/1 = INC/DEC
3、輸出：Q3-Q0
可以增加的引腳：
4、進(jìn)位：CY
5、輸入：D3-D0
6、置數(shù)：SET
7、清0：CLR
8、更的D與Q，位數(shù)。
……

1、寫出真值表
2、根據(jù)真值表，寫出邏輯公式。
3、開工FPGA寫作。

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