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DCDC升壓電路輸出雜波

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樓主
3.7V升壓,帶載輸出5V,1A,5V上有如圖片雜波,是PCB布線問題嗎,空載就不會有雜波

1716788229433.png (160.85 KB, 下載次數(shù): 34)

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ID:807591 發(fā)表于 2024-5-27 15:35 | 只看該作者
輸出電容 加大一點(diǎn)
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板凳
ID:123289 發(fā)表于 2024-5-27 16:11 | 只看該作者
不是。
開關(guān)信號是階躍性質(zhì)。其它頻譜很廣,會有雜波,雜波隨著能量增大。
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地板
ID:88256 發(fā)表于 2024-5-27 16:22 | 只看該作者
個人認(rèn)為,開關(guān)電路本身就會有諧波,所以正常使用,輸入和輸出都得并一個0.1uF的電容進(jìn)行濾波,你加上試試效果怎么樣。
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5#
ID:28752 發(fā)表于 2024-5-27 20:18 | 只看該作者
電容盡量靠近IC,電容上并一顆104,同樣盡量靠近IC試試。。。
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6#
ID:1104113 發(fā)表于 2024-5-28 08:32 | 只看該作者
這個是共模干擾
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7#
ID:879348 發(fā)表于 2024-5-28 10:37 | 只看該作者
這個是正常的,開關(guān)電源的通病,所以通常要求DCDC不要直接供電單片機(jī)
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8#
ID:1007932 發(fā)表于 2024-5-28 18:08 | 只看該作者
正,F(xiàn)象,開關(guān)電源基本都這樣,常規(guī)的是并一顆小電容,一般是104的,通常單片機(jī)足夠了,要求不是很高,要求高加濾波電路,像模擬電路就比較敏感,一般要額外處理,DAC也是,主要看用途,滿足要求就行
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9#
ID:69038 發(fā)表于 2024-5-28 23:56 | 只看該作者
DCDC的布局很關(guān)鍵,Cin,Cout,L,D盡量靠近IC,Cin和Cout容量盡量大點(diǎn),并選用低ESR的電容,如鉭電容。地線要強(qiáng)壯點(diǎn),盡量有大面積的私地(本電路中的GND),并通過一個磁珠接到總地(板上的GND)。

另外有個方法,你參考一下:
在L的電感兩端,并一個阻容串,10k-4.7K+102-101,在R1兩端并一個102-104。
說不出什么原理,反正我UV雙段的接收機(jī),經(jīng)過這樣處理,某些頻點(diǎn)的干擾就好多了,靈敏度也上來了?赡苁荄CDC電路的諧波太豐富了吧。
只是參考,不保證一定能好,因?yàn)槲矣玫碾娐肥墙祲盒偷腄CDC,而你這個是升壓型的,你可以試試看。
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10#
ID:491875 發(fā)表于 2024-5-29 07:45 | 只看該作者
增加一只104和103瓷片電容以增加高頻濾波效果。
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11#
ID:491875 發(fā)表于 2024-5-29 11:19 | 只看該作者
szb314 發(fā)表于 2024-5-27 15:35
輸出電容 加大一點(diǎn)

對于高頻電源電路,增加輸出電容并不一定會改善輸出高頻干擾,因?yàn)殡娙萑萘康脑黾觿荼貙?dǎo)致等效電感的增加,所以,在一些要求比較高的高頻電源電路中往往采用多只電容并聯(lián)來增大電容容量。并且同時并聯(lián)一些小容量瓷片電容來消除高頻干擾。小容量電容的等效電感相對大容量電容要小的多。所以,一些電源電路中可以同時見到104,103容量的電容與較大容量的電容并聯(lián)各司其職。
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12#
ID:1034262 發(fā)表于 2024-5-29 17:06 | 只看該作者
正常,你加一級LC濾波即可。
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13#
ID:1137921 發(fā)表于 2024-12-27 13:41 | 只看該作者
樓主可以參考一下這圖,這是中控微型打印機(jī)的供電電源,雖然芯片不一樣,但輸入輸出濾波處理可以借鑒。

CANK.png (424.31 KB, 下載次數(shù): 0)

參考圖

參考圖
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14#
ID:879348 發(fā)表于 2024-12-27 16:34 | 只看該作者
對于開關(guān)電源這是無法消除的
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15#
ID:420836 發(fā)表于 2024-12-28 03:27 | 只看該作者
首先,確保你的PCB布局是優(yōu)化的,例如IC芯片周圍的所有元件都盡可能靠近IC放置,特別是輸出電容。其次,確保使用適當(dāng)?shù)姆椒ㄟM(jìn)行測量。在這種情況下,如果示波器探頭具有長的鱷魚夾接地夾,可能需要將其更換為短的彈簧夾,以替換長的接地夾。然后再試一次。
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16#
ID:517951 發(fā)表于 2024-12-28 10:07 | 只看該作者
5V輸出端增加1uf+ 0.1uf+ 0.01uf 瓷片電容+100uf的鉭電容,  也可以串入0603磁珠.  
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17#
ID:1038657 發(fā)表于 2025-1-22 09:51 | 只看該作者
PCB呢,首先看下layout guide,確認(rèn)布局沒問題,其次計(jì)算電感電容最小值,然后嘗試加大電容電感對比,最后實(shí)在沒辦法換同樣總?cè)萘康碾娙荩嗯獛讉,降低ESR看效果,多動手
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18#
ID:466250 發(fā)表于 2025-1-22 14:44 | 只看該作者
這就是所謂的電磁輻射引起的,布線很關(guān)鍵。電感換屏蔽的也會降低。
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19#
ID:382454 發(fā)表于 2025-2-24 15:13 | 只看該作者
加多幾個高頻的PF電容,和幾個大一點(diǎn)的高頻低阻電解在芯片旁邊看看。
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20#
ID:1087128 發(fā)表于 2025-2-25 08:13 | 只看該作者
結(jié)果是測試問題,探頭干擾
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21#
ID:123917 發(fā)表于 2025-2-25 23:42 | 只看該作者
LHWCCJ 發(fā)表于 2025-2-25 08:13
結(jié)果是測試問題,探頭干擾

那空載為啥沒事?
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22#
ID:466250 發(fā)表于 2025-2-26 01:53 | 只看該作者
空間傳導(dǎo)雜訊,無法消除只能降低
布線可以降低
RC吸收也可以降低
使用頻率低的DCDC也會降低
使用屏蔽電感也可降低
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