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經(jīng)驗累積,設(shè)計電路時需要注意哪些方面的問題?

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樓主
ID:191024 發(fā)表于 2017-4-23 22:20 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
設(shè)計電路時需要注意哪些方面的問題。
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ID:123289 發(fā)表于 2017-4-24 02:01 | 只看該作者
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板凳
ID:192883 發(fā)表于 2017-4-24 09:21 | 只看該作者
不可隨便抄襲,一些經(jīng)典常用電路設(shè)計應(yīng)該摸清楚原理,才能用的更好。
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地板
ID:192928 發(fā)表于 2017-4-24 09:34 來自手機 | 只看該作者
注意布局布線問題
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5#
ID:192968 發(fā)表于 2017-4-24 10:49 | 只看該作者
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6#
ID:192968 發(fā)表于 2017-4-24 10:53 | 只看該作者
1、總線信號都用電阻拉一下   
    信號需要上下拉的原因挺多,但不是每一個都需要。上下拉電阻啦一個單純的輸入信號,電流也就幾十微安以下。如果拉一個被驅(qū)動的信號,電流將會達到毫安級。如果對于數(shù)據(jù)和地址總線上的信號,都進行上拉,幾瓦的功耗都將消耗在上面。
2、CPU和FPGA不用的信號怎么處理
    如果選擇懸空,受外界一點點干擾,就可能成為反復(fù)震蕩的輸入信號。MOS器件的功耗基本取決于門電路的翻轉(zhuǎn)次數(shù)。如果全部上拉,也會有微安級電流,所以最好設(shè)置成輸出。
3、存儲芯片的片選信號接地
    大部分存儲器在片選有效時候的功耗是片選無效時候的100倍以上,所以最好使用CS來控制芯片,而不要一直接地。并且在滿足要求的情況下,盡可能的縮短片選脈沖的寬度。
4、關(guān)于信號過沖
    大部分信號都是有過沖的,如果過沖不是很大,就不需要添加匹配電阻。如果和輸出阻抗匹配上同樣大小的電阻,將會導(dǎo)致電流大,提高了功耗,也會減小信號幅度,嚴(yán)重的時候?qū)䦟?dǎo)致不能使用。所以對于TTL、LVDS、422等信號,只要做到過沖可以接受即可。
5、電源芯片功耗問題
    電源芯片等一些小芯片,手冊上寫的功耗很小,但是加上負載之后就不一樣了。在使用這些芯片的時候,需要注意所帶的負載情況。
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7#
ID:192989 發(fā)表于 2017-4-24 11:33 | 只看該作者
小心謹(jǐn)慎,不要只注重速度。搞一個萬用表,隨時檢查故障,分塊解決故障。
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8#
ID:191024 發(fā)表于 2017-4-29 22:55 | 只看該作者
dabin1314 發(fā)表于 2017-4-24 10:49
把自己的每一次失誤記錄下來。
把改進后的與改進前的做版本區(qū)別且都存檔。
每一次改進都做一個說明

我自己之前也有做相關(guān)的記錄,因為剛出來實習(xí);剛開始設(shè)計出來的電路經(jīng)耐放電后老是有不同的器件損壞。沒規(guī)律可循。
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9#
ID:111634 發(fā)表于 2017-4-30 09:21 | 只看該作者
3年以上苦功夫
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