|
AD16的主要功能是畫電路原理圖和根據(jù)電路原理圖設(shè)計PCB板。為了使設(shè)計的電路、畫完的電路原理圖，從電路原理上不存在錯誤，從電路邏輯上不存在混亂，AD16專門開發(fā)了電路原理圖的仿真程序。這樣可以把設(shè)計存在的問題，在第一步：繪制電路原理圖階段就及時發(fā)現(xiàn)，然后根據(jù)仿真結(jié)果，改進(jìn)電路原理圖。這就避免了等到印刷電路板裝配零件完成為成品之后再發(fā)現(xiàn)問題時，造成的大量的人力物力損失。 同樣：設(shè)計PCB時，也是先在電腦上根據(jù)電路原理圖，繪制PCB板圖。然后再把電腦PCB板圖拿到PCB工廠生產(chǎn)PCB板。AD16同樣設(shè)計了PCB板信號完整性分析程序，把電腦上繪制的PCB板圖，進(jìn)行信號完整性仿真分析，從而早期發(fā)現(xiàn)設(shè)計的PCB板圖是否存在瑕疵，及時改進(jìn)到理想狀態(tài)。如果繪制好PCB板圖，沒有經(jīng)過PCB板圖的信號完整性分析仿真，直接拿到工廠生產(chǎn)PCB板，PCB板裝配完工成為成品后，才發(fā)現(xiàn)有瑕疵，那就造成了極大的浪費(fèi)。 PCB板的信號完整性分析，是指PCB板中的一個網(wǎng)絡(luò)，這個網(wǎng)絡(luò)的輸出波形，與該網(wǎng)絡(luò)的輸入波形相比，盡量的相似，盡量的少失真、少延遲、少變形、少缺失、少振鈴、少過沖。低頻的數(shù)字電路PCB板，輸入信號經(jīng)過PCB內(nèi)網(wǎng)絡(luò)的處理后，網(wǎng)絡(luò)輸出的信號波形失真很小，而在高頻的數(shù)字電路PCB板，如果PCB板設(shè)計稍有不當(dāng)，被測試的網(wǎng)絡(luò)輸出信號與該網(wǎng)絡(luò)輸入信號相比，就會產(chǎn)生明顯的延遲、失真，導(dǎo)致生產(chǎn)的PCB板不達(dá)標(biāo)，無法使用。 進(jìn)行信號完整性分析的前提條件：需要具備以下條件，才能進(jìn)行信號完整性分析： - 電路中被測試的網(wǎng)絡(luò)，必須包含IC的一個信號輸出腳，這個輸出信號作為激勵這個網(wǎng)絡(luò)的信號源。如果一個網(wǎng)絡(luò)只有R、L、C等無源器件，沒有晶體管、IC等有源器件，那么這個無源網(wǎng)絡(luò)，就不能進(jìn)行信號完整性分析。也就是說：必須設(shè)定被測試網(wǎng)絡(luò)的激勵源。
- 在繪制電路原理圖、PCB板圖時，繪圖使用的零件庫應(yīng)當(dāng)使用集成零件庫，集成零件庫里面的零件包含了電路原理圖符號、封裝符號、仿真模型、信號完整性模型。如果零件庫里的零件不包含完整性模型，就必須登錄零件生產(chǎn)商的官網(wǎng)，下載信號完整性模型，或從其他文件找到模型。然后再加載到工程文件里面來。也可以在原理圖中調(diào)整模型。
- 設(shè)定電路原理圖中的電源網(wǎng)絡(luò)電壓值(如3.3V\5V\12V等等)、把電路圖中電源的地網(wǎng)絡(luò)，設(shè)定為0V。
- 設(shè)定PCB板的PCB板層堆疊：單擊design-------layer stack manager。一般采用系統(tǒng)默認(rèn)值即可。
通過PCB板的信號完整性分析，可以仿真測量輸入信號通過一個網(wǎng)絡(luò)后，產(chǎn)生的反射畸變和相鄰網(wǎng)絡(luò)之間的信號串?dāng)_。 注意：進(jìn)行信號完整性分析時，被測試的PCB文件，必須在工程中，不能是獨(dú)立存在的free docment。
信號完整性分析的實例： 1、打開工程文件夾：projedts。這個工程文件夾內(nèi)包括：電路原理圖文件sch PCB板文件pcb。打開PCB板圖。見下圖。 2、設(shè)置PCB板的板層堆疊管理：design------layer stack manager-------彈出下圖對話框： 單擊上圖右邊：impedance calculation標(biāo)簽，彈出PCB阻抗計算對話框，見下圖： 上圖，采用默認(rèn)值即可。 3、單擊：design-----rules------彈出規(guī)則對話框，見下圖： 在上圖中左下部位找到信號激勵：signal stimulus，在signal stimulus上面右鍵單擊，選擇new rule，見下圖： 在上圖的右側(cè)欄，設(shè)置激勵信號的參數(shù)，采用系統(tǒng)默認(rèn)值即可。 - 設(shè)置電壓和地網(wǎng)絡(luò)：在下圖的左下角，單擊：supply net，選擇new rule.
在下圖中，右上策新出現(xiàn)的電源網(wǎng)絡(luò)，把GND網(wǎng)絡(luò)電壓設(shè)置為0V，將VCC電壓設(shè)置為5V。然后單擊OK。
- 選擇tools-----signal integrity------彈出一下對話框：
單擊上圖model assignnent配置完整性分析模型，就會彈出下面的對話框： 上表中的名稱解釋： Not match: 表示AD16程序沒有找到該器件的完整性分析模型。需要人為指定。 Low confidence:程序自動為該器件指定了一個模型，但置信度很低。 Medium confidence：中級置信度。 High confidence：置信度很高。 Model found：該器件的模型已經(jīng)找到。 User modifined: 用戶修改了模型。 Model added：用戶創(chuàng)建了模型。 修改期間完整性分析模型的步驟：雙擊上圖中要修改模型器件的status部分-------彈出下圖：完整性分析模型修改對話框------在TAPE選項中選擇器件的類型-------在technology選項中選擇驅(qū)動類型-------也可以從外部文件導(dǎo)入與該器件相關(guān)聯(lián)的IBIS模型-------大家IMPORT IBIS-------選擇從器件廠商哪里得到的IBIS模型即可-----單擊OK。單擊上圖左下角：update model schematic,將修改后的模型更新到原理圖中。單擊上圖中右下角的analyze design標(biāo)簽------程序進(jìn)入信號完整性分析------彈出：signal integrity分析網(wǎng)絡(luò)狀態(tài)表格：見下面第二圖：
上面的網(wǎng)絡(luò)完整性分析表格：status，最左的net：代表網(wǎng)絡(luò)名稱，作數(shù)第二：status，標(biāo)明這個網(wǎng)絡(luò)是否通過了完整性分析（failed：沒有通過）、沒有分析（not analyze）、分析通過（passed）。上表中的falling edge overshoot:代表脈沖下降沿過沖，falling edge undershoot:代表脈沖下降沿衰減。Rising edge overshoot:代表上升沿過沖。Rising edge undershoot：代表上升沿衰減。 - 怎樣查看上面網(wǎng)絡(luò)表中某一個網(wǎng)絡(luò)的完整性分析結(jié)果：右鍵單擊上表中第三個網(wǎng)絡(luò)：TXB-------在下拉菜單中選擇details細(xì)節(jié)--------彈出下圖：full result（該網(wǎng)絡(luò)分析的詳細(xì)結(jié)果）。
雙擊上圖中網(wǎng)絡(luò)名稱：TXB-------就可把網(wǎng)絡(luò)TXB運(yùn)動到上圖中的右側(cè)：net（網(wǎng)絡(luò)框中）-----此時上圖右下角灰色（無效）的reflections變成黑色（有效）-------見下圖： 單擊上圖右下角的reflections-------顯示輸入波形和輸出帶有反射的波形：見下圖。 右鍵單擊上圖中右上角紅色的TXB-U2 13-NOterm-------在彈出的下拉菜單中選擇光標(biāo)A和光標(biāo)B，見下圖： 利用上圖中的光標(biāo)A和光標(biāo)B，精確測量，測量結(jié)果顯示在sin data（在顯示信號完整性分析的AD16窗口前提下，AD16屏幕的右下角，顯示有：sin data標(biāo)簽）中。
9：網(wǎng)絡(luò)輸出端式接不同的匹配電阻，以消除輸出端的反射波形。見下圖的右下角：給出了網(wǎng)絡(luò)輸出端試結(jié)串聯(lián)電阻、并聯(lián)電阻、串聯(lián)電容、并聯(lián)電容、并聯(lián)D時的不同情況下，分別查看哪種情況下網(wǎng)絡(luò)輸出端的反射波形最小。試現(xiàn)在在網(wǎng)絡(luò)輸出端串聯(lián)電阻的方法：serial res。如下面的第二圖所示： （上圖右下角no termination:表示輸出端沒有接任何匹配電阻）
上圖serial res：表示網(wǎng)絡(luò)輸出端串聯(lián)了匹配電阻。上圖中:min：代表匹配電阻取值的最小值：25歐，max:代表匹配電阻取值的最大值是150歐，這兩個數(shù)值可以有用戶任意修改。設(shè)定完最大值和最小值后，選中進(jìn)行掃描：perform sweep，單擊上圖右下角的reflection------匹配電阻取值在25歐--------150歐之間聯(lián)系均勻改變時，網(wǎng)絡(luò)輸出端反射波形，在哪個歐姆時最小。以此找到匹配電阻的最佳電阻值。 10、PCB板相鄰網(wǎng)絡(luò)的串?dāng)_分析：雙擊上圖中左上角的TXB，使之選中進(jìn)入上圖右上角的NET內(nèi)，再雙擊相鄰的網(wǎng)絡(luò)RTSB，也選中到右上角的NET內(nèi)，右鍵單擊右上角NET內(nèi)的TXB,在下拉菜單中選擇：set aggressor，把TXB設(shè)定為入侵者（干擾源），RTSB網(wǎng)絡(luò)就是受干擾網(wǎng)絡(luò)了。單擊上圖右下角的cross talk標(biāo)簽，分析串?dāng)_，過一會就顯示串?dāng)_的波形。
作者： 吳善龍2017-09-03
以上的圖文Word格式文檔51黑下載地址（方便保存,內(nèi)附清晰圖）:
PCB板的信號完整性分析.doc
(1.17 MB, 下載次數(shù): 177)
2017-9-3 21:43 上傳
點(diǎn)擊文件名下載附件
下載積分: 黑幣 -5
| 
[復(fù)制鏈接]
QQ好友和群
QQ空間
騰訊微博
騰訊朋友
收藏
淘帖
頂
踩
