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發(fā)布時(shí)間: 2018-4-2 14:03
正文摘要:這是我用Altera公司下集成軟件Quartus II硬件開(kāi)發(fā)板來(lái)實(shí)現(xiàn)的，通過(guò)Verilog HDL硬件描述性語(yǔ)言建模來(lái)分層次分模塊設(shè)計(jì)一個(gè)具有時(shí)分秒的電子鐘并能設(shè)置任意時(shí)刻鬧鐘，在ModelSim上仿真測(cè)試，最后在Cyclone IV E的FPGA ... |
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