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Altium Designer編譯時如何讓這種網(wǎng)絡(luò)報錯?

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發(fā)布時間: 2022-11-23 22:35

正文摘要:

舉例說明,如下兩張圖是在不同的sheet,正確的網(wǎng)絡(luò)名是“TEST”,但是另外一頁誤寫成了"TESTT",于是乎就失去電氣連接了。但在編譯原理圖時,這種錯誤并不會報出來,請問有沒有什么辦法能規(guī)避這個錯誤,編譯時讓 ...

回復(fù)

ID:401564 發(fā)表于 2022-11-28 18:01
沒有畫過很復(fù)雜的電路,所以對AD也只是學(xué)到能用的階段而已,不知道是不是有什么高級的設(shè)置可以報錯
我一般都是畫好了再一個一個的去對
個人感覺應(yīng)該用網(wǎng)絡(luò)點好點,如果是沒有連接上,就會有兩個單獨的網(wǎng)絡(luò)點,檢查會有警告
ID:25903 發(fā)表于 2022-11-25 11:33
如果你的port是輸入或者輸出,如果沒有另外一個對應(yīng)的輸出或輸入port,那么編譯時也會報錯。你可以把原理圖發(fā)給我,我來幫你看。
ID:847776 發(fā)表于 2022-11-24 21:32
dandan-tcb 發(fā)表于 2022-11-24 19:29
你要設(shè)置編譯檢查項:
菜單欄--project--projectparameter--error reporting--violations associated with ...

這是單端網(wǎng)絡(luò)設(shè)置,我圖中并不是單端網(wǎng)絡(luò),是有連接到電阻的。

甚至Error reporting整頁全部設(shè)置成warning或error,都不會報錯。
ID:25903 發(fā)表于 2022-11-24 19:29
你要設(shè)置編譯檢查項:
菜單欄--project--projectparameter--error reporting--violations associated with net--net with only one pin
這一項設(shè)置成error

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