Verilog教程PPT講稿-建模、仿真、綜合、驗(yàn)證和實(shí)現(xiàn)（共100頁）

ID:384063 · 發(fā)表于 2018-8-8 16:17

Verilog 教程講稿
講課的主要內(nèi)容
復(fù)雜數(shù)字系統(tǒng)與信號(hào)處理的關(guān)系
為什么要研究復(fù)雜的數(shù)字邏輯系統(tǒng)
設(shè)計(jì)數(shù)字系統(tǒng)的基本方法
設(shè)計(jì)復(fù)雜數(shù)字系統(tǒng)的工具和手段
數(shù)字系統(tǒng)的基本結(jié)構(gòu)
Verilog 語言的特點(diǎn)和基本語法

Verilog模塊和電路結(jié)構(gòu)的關(guān)系
兩種不同的Verilog模塊
可綜合模塊的風(fēng)格
測試用模塊的編寫要點(diǎn)
語法要點(diǎn)
設(shè)計(jì)示例分析

怎樣設(shè)計(jì)如此復(fù)雜的系統(tǒng)？
現(xiàn)代的設(shè)計(jì)方法（續(xù)前）：
- 選用合適的基本邏輯元件庫和宏庫
- 租用或購買必要的IP核；
- 選用合適的綜合器；
- 進(jìn)行綜合得到門級(jí)電路結(jié)構(gòu)；
- 布局布線，得到時(shí)延文件；
- 后仿真；
- 定型， FPGA編碼或ASIC投片

完整的ppt格式文檔51黑下載地址（共100頁）：

Verilog教程2004.rar (76.59 KB, 下載次數(shù): 42)

ID:30894 · 發(fā)表于 2018-9-2 08:15

謝謝樓主

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