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FPGA DE2與Quartus開(kāi)發(fā)實(shí)訓(xùn)PPT課件下載

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數(shù)字設(shè)計(jì)流程
常用的EDA軟件工具簡(jiǎn)介
DE2開(kāi)發(fā)實(shí)例(6個(gè)實(shí)驗(yàn))
實(shí)驗(yàn)一 3-8譯碼器實(shí)驗(yàn)
實(shí)驗(yàn)二 十進(jìn)制計(jì)數(shù)器實(shí)驗(yàn)
實(shí)驗(yàn)三 燈光控制實(shí)驗(yàn)
實(shí)驗(yàn)四 移位寄存器實(shí)驗(yàn)
實(shí)驗(yàn)五 LCD顯示實(shí)驗(yàn) (NiosII)
實(shí)驗(yàn)六 跑馬燈實(shí)驗(yàn) (NiosII)

將較高層次的設(shè)計(jì)描述自動(dòng)轉(zhuǎn)化為較低層次描述的過(guò)程
◆行為綜合:從算法表示、行為描述轉(zhuǎn)換到寄存器傳輸級(jí)(RTL)
◆邏輯綜合:RTL級(jí)描述轉(zhuǎn)換到邏輯門級(jí)(包括觸發(fā)器)
◆版圖綜合或結(jié)構(gòu)綜合:從邏輯門表示轉(zhuǎn)換到版圖表示,或轉(zhuǎn)換到PLD器件的配置網(wǎng)表表示
    綜合器是能自動(dòng)實(shí)現(xiàn)上述轉(zhuǎn)換的軟件工具,是能將原理圖或HDL語(yǔ)言描述的電路功能轉(zhuǎn)化為具體電路網(wǎng)表的工具


布局布線可理解為將綜合生成的電路邏輯網(wǎng)表映射到具體的目標(biāo)器件中實(shí)現(xiàn),并產(chǎn)生最終的可下載文件的過(guò)程。
布局:將已分割的邏輯小塊放到器件內(nèi)部邏輯資源的具體位置,并使它們易于連線
布線:利用器件的布線資源完成各功能塊之間和反饋信號(hào)之間的連接



全部資料51hei下載地址:
EDA9.11.rar (7.2 MB, 下載次數(shù): 28)


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