Verilog HDL 的邏輯運(yùn)算符

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樓主

ID:579775 發(fā)表于 2020-12-22 20:36 | 只看該作者回帖獎(jiǎng)勵(lì)

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在Verilog HDL語(yǔ)言中存在三種邏輯運(yùn)算符:
1) && 邏輯與
2) || 邏輯或
3) ! 邏輯非
"&&"和"||"是二目運(yùn)算符,它要求有兩個(gè)操作數(shù),如(a>b)&&(b>c),(a<b)||(b<c)。"!"是單目運(yùn)算符,
只要求一個(gè)操作數(shù),如!(a>b)
邏輯運(yùn)算符中"&&"和"||"的優(yōu)先級(jí)別低于關(guān)系運(yùn)算符,"!" 高于算術(shù)運(yùn)算符。見(jiàn)下例:
(a>b)&&(x>y) 可寫(xiě)成: a>b && x>y
(a==b)||(x==y) 可寫(xiě)成:a==b || x==y
(!a)||(a>b) 可寫(xiě)成: !a || a>

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