STC單片機(jī)的IO口中開漏是什么意思！？

ID:234132 · 發(fā)表于 2017-10-26 13:06

STC單片機(jī)的IO口中開漏是什么意思�。�

ID:126608 · 發(fā)表于 2017-10-26 16:00

就是斷開io口連接的漏電電路，成為只受外部電壓控制的io口。一般做電壓測量用。

ID:61876 · 發(fā)表于 2017-10-26 16:14

MOS管的漏極開路。IO口中的P0口是這種情況，其它三個IO口內(nèi)部全部在漏極接有上拉電阻。

ID:1 · 發(fā)表于 2017-10-26 16:20

詳見知識貼：http://www.torrancerestoration.com/bbs/dpj-49412-1.html

ID:243188 · 發(fā)表于 2017-10-26 17:23

而開漏模式，即可作為輸出，也可作為輸入。作輸出時，要輸出高電平，需要外加上拉電阻。作輸入時，要求處理高電平狀態(tài)，才能讀外部引腳。

ID:243273 · 發(fā)表于 2017-10-26 21:52

需要加上拉電阻

ID:243273 · 發(fā)表于 2017-10-26 21:53

需要加上拉電阻

ID:243310 · 發(fā)表于 2017-10-26 23:29

先學(xué)習(xí)MOS，就明白了

ID:243310 · 發(fā)表于 2017-10-26 23:30

看看MOS的資料就明白了

ID:123289 · 發(fā)表于 2017-10-27 13:01

簡單舉一例，NPN的三極管，B接輸入電路、E接地、C空著什么也不接，這是Ｃ作為輸入出，就叫OC輸了（OPEN C）；如果是MOS管呢，這是“C”對應(yīng)是MOS的漏“D”，就叫開漏。

ID:975054 · 發(fā)表于 2023-9-1 18:32

今天碰到個奇怪事情: STC8的I2C時鐘腳我設(shè)為開漏輸出,外部有10K上拉電阻, 我設(shè)置為禁止輸入I2C就不能正常工作。之前I2C和MCU電平匹配設(shè)為雙向置1時，這個腳可以禁止輸入的。

ID:883242 · 發(fā)表于 2023-9-2 12:48

找本《數(shù)字電路》教材，找到“線與”那一節(jié)，你就知道開漏是什么意思了。

ID:975054 · 發(fā)表于 2023-9-2 18:50

ax6808 發(fā)表于 2023-9-1 18:32
今天碰到個奇怪事情: STC8的I2C時鐘腳我設(shè)為開漏輸出,外部有10K上拉電阻, 我設(shè)置為禁止輸入I2C就不能正常 ...

總之目前情況: STC8G1K08A的I2C二個腳設(shè)置為開漏的話(外部有10K上拉電阻) 時，二個腳都應(yīng)默認(rèn)設(shè)置為允許輸入，I2C才能正常工作！之前I2C和MCU供電3.3V一致時，設(shè)置為雙向置1時，這個時鐘腳可以禁止輸入的。特殊原因，我一般只輸出的腳都設(shè)置為禁止輸入了。

ID:975054 · 發(fā)表于 2023-9-2 19:28

ax6808 發(fā)表于 2023-9-2 18:50
總之目前情況: STC8G1K08A的I2C二個腳設(shè)置為開漏的話(外部有10K上拉電阻) 時，二個腳都應(yīng)默認(rèn)設(shè)置為允許 ...

看了你的文章，啟發(fā)很大！
之前我MCU有硬件I2C口，只接一個共用3.3V電源的從機(jī)，MCU二腳可設(shè)置為雙向置1，SCL可以禁止輸入，工作很正常的（其實可能不夠可靠）。后來改為不共用電源后，已設(shè)置為開漏，外部有上拉電阻，結(jié)果就不正常了。后來檢查發(fā)現(xiàn)這種情況SCL就得設(shè)置回默認(rèn)的允許輸入才行！可能是有些代碼變了響應(yīng)不及時，SCL禁止輸入主機(jī)就探測不到被拉低了所以出錯！
總之：而腳都得默認(rèn)允許輸入！

ID:280979 · 發(fā)表于 2023-9-2 21:41

開漏輸出就相當(dāng)于三極管集電極懸空使用時為灌電流輸入。需要加個上拉電阻，NPN輸出型電路。

ID:1092502 · 發(fā)表于 2023-9-2 22:35

輸出高無效！

ID:1034262 · 發(fā)表于 2023-9-4 13:46

就是漏極開路的意思。

ID:420836 · 發(fā)表于 2023-9-7 07:42

MOS管開漏電路需要外接上拉電阻和電源以保證邏輯正確。

ID:1092878 · 發(fā)表于 2023-9-7 13:00

負(fù)載電壓預(yù)留

ID:77589 · 發(fā)表于 2023-9-12 15:40

下拉MOS的漏極懸空，這樣配置的IO口不能輸出高電平，如果需要正常輸出需要外接上拉電阻，好處在于，可以輕松實現(xiàn)線與功能。

ID:1093061 · 發(fā)表于 2023-9-12 17:58

意思就是在使用的時候需要一個上拉電阻

ID:1092275 · 發(fā)表于 2023-9-13 16:40

MOS管的漏極開路

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