EDA的VHDL語(yǔ)言程序錯(cuò)誤求助

ID:950255 · 發(fā)表于 2022-5-28 17:07

哪位高人可以指點(diǎn)我一下這些錯(cuò)誤怎么改

ID:929201 · 發(fā)表于 2022-8-14 16:56

以我淺薄的初學(xué)經(jīng)驗(yàn)，在用integer的時(shí)候是不是需要用subtype限定range范圍呀。變量聲明應(yīng)該是 VARIABLE 變量名：數(shù)據(jù)類型的吧。另外第一張圖里integer也打錯(cuò)了

ID:139866 · 發(fā)表于 2022-8-15 09:58

1.定義n的時(shí)候冒號(hào)后邊跟等號(hào)是什么意思？學(xué)這么多年我頭一次見(jiàn)這么寫(xiě)的
2.定義n的時(shí)候integer寫(xiě)對(duì)了嗎？
3.你讓人幫你看程序，起碼把程序全發(fā)出來(lái)啊，你就截那幾張圖，連行號(hào)都不截，你是讓人幫你猜嗎？能全給你猜出來(lái)那不叫大神，叫神仙；
4.你發(fā)帖之前可以先拿課本一個(gè)一個(gè)的對(duì)，很多錯(cuò)誤仔細(xì)對(duì)一下就能發(fā)現(xiàn)，你要是邏輯用法之類的不明白還能幫你，你找錯(cuò)都得找人幫你找那我覺(jué)得你不適合走EDA這條路，畢竟這點(diǎn)程序連基礎(chǔ)中的基礎(chǔ)都算不上，以后畫(huà)電路之類的我覺(jué)得你更會(huì)崩潰

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