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預(yù)覽 用VHDL編寫的籃球30秒計時器 attach_img agree uid:793816 2021-6-4 22:14 13502 2023-1-1 15:55
預(yù)覽 基于FPGA的洗衣機控制器設(shè)計 VHDL程序 attachment agree uid:816987 2020-11-30 08:52 23940 2022-12-27 16:49
預(yù)覽 FPGA電壓采集DA輸出原理圖 attach_img uid:523823 2022-12-12 15:51 02327 2022-12-12 15:51
預(yù)覽 基于VHDL語言的電子時鐘設(shè)計-ISE開發(fā)的EDA源碼 晶振25Mhz attach_img agree uid:191542 2019-1-9 21:42 35897 2022-12-11 01:48
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預(yù)覽 Quartus Verilog HDL/FPGA 驅(qū)動4位動態(tài)數(shù)碼管演示4位16進制累加 (每隔1秒加1) attach_img agree uid:57657 2022-1-16 09:27 23848 2022-2-16 12:38
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