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預(yù)覽 交通燈控制系統(tǒng)EDA VHDL語言和QuartusII 12.0軟件 新人帖 attach_img uid:183257 2017-3-25 15:19 04543 2017-3-25 15:19
預(yù)覽 8位加法計數(shù)器 vhdl程序 attach_img uid:147586 2016-11-13 00:07 15618 2017-3-23 02:55
預(yù)覽 VerilogHDL那些事兒_建模篇 很好的pdf電子書 圖文并茂 條理清晰 新人帖 attach_img uid:166706 2017-2-26 12:17 15339 2017-2-27 17:13
預(yù)覽 呵呵,上傳一個FPGA疊加的效果圖 uid:114320 2016-5-10 03:38 45300 2017-2-26 12:13
預(yù)覽 基于CPLD的三相多波形函數(shù)發(fā)生器設(shè)計 新人帖 attach_img uid:165555 2017-2-20 16:08 03576 2017-2-20 16:08
預(yù)覽 CPU行為模型vhdl 新人帖 attach_img agree uid:161488 2017-1-27 14:56 05278 2017-1-27 14:56
預(yù)覽 FPGA技術(shù)的五大優(yōu)勢 uid:101093 2016-12-14 18:12 03308 2016-12-14 18:12
預(yù)覽 交通燈設(shè)計 _VHDL(程序見附件) 新人帖 attachment uid:153825 2016-12-11 11:18 05027 2016-12-11 11:18
預(yù)覽 FPGA/CPLD數(shù)字電路設(shè)計經(jīng)驗分享 新人帖 attach_img agree uid:153048 2016-12-7 22:42 03483 2016-12-7 22:42
預(yù)覽 推薦一種新型內(nèi)存擴(kuò)充方案:串行PSRAM uid:152336 2016-12-6 09:30 03883 2016-12-6 09:30
預(yù)覽 基于Quartus的分頻器設(shè)計(含原理圖及代碼兩種方法) 新人帖 attach_img agree uid:150657 2016-12-2 23:56 014978 2016-12-2 23:56
預(yù)覽 分頻器Verilog設(shè)計 attach_img agree uid:112613 2016-11-25 22:19 04515 2016-11-25 22:19
預(yù)覽 四人搶答器 新人帖 attach_img uid:112613 2016-11-25 22:03 07611 2016-11-25 22:03
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預(yù)覽 VHDL數(shù)字電子鐘設(shè)計 新人帖 attachment agree uid:143948 2016-10-22 17:29 03733 2016-10-22 17:29
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預(yù)覽 Can't place multiple pins assigned to pin location Pin ... uid:109770 2016-3-22 20:07 04247 2016-3-22 20:07
預(yù)覽 FPGA學(xué)習(xí)-高性能計數(shù)器IP核調(diào)用與驗證 uid:108531 2016-3-12 22:42 16459 2016-3-14 00:29
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